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DB-E806 FPGA教學開發(fā)創(chuàng)新平臺

 

FPGA實驗箱是適合新工科專業(yè)進行EDA課程教學實驗以及課程設計的工具。系統(tǒng)由CPU核心子板、平臺模塊母板、擴展接口子板等幾部分組成。實驗內容豐富生動形象，能夠大大的激發(fā)學生的興趣，使學生老師在教學的過程中能夠寓教于樂，同時在學習EDA的同時可以加強對控制、通信、單片機等課程進行加深，讓學生學有所得。

二、結構特點：
CPU核心子板主芯片采用用ALTERA CycloneIV系列中的EP4CE6用戶可更換其它核心子板；
模塊化設計，每個模塊相對獨立，做實驗時將模塊與核心板連接起來即可；
CPU核心子板板載USB-BLASTER下載調試器，只需一根USB連接線即可完成程序的加載、調試與固化，同時方便實驗室管理；
CPU核心子板自帶SDRAM與FLASH，可用于NIOSII、IP CORE設計驗計；
豐富的實驗模塊，在數字電路的基礎上增加了控制類、接口類、通信類的實驗模塊；
二個時鐘源，四路輸出，每路相對獨立， 24MHZ—1HZ的頻率能滿足用戶要求；
核心板FPGA芯片I/O管腳開放，用戶可以任意定義；
豐富的樣板實驗程序，在常規(guī)的EDA實驗基礎上增加了交通燈、電梯、步進電機、直流電機、PS2、VGA、音樂、鍵盤等實驗，實驗內容形象生動；
QUARTUS11.0開發(fā)軟件，支持多種語言輸入，自帶LICENSE；
詳細的操作手冊，含軟、硬件的使用說明，各模塊的功能說明。

核心板規(guī)格說明：
FPGA核心板主芯片采用ALTERA CycloneII系列中的EP4CE6E22C8N
FPGA內門電路高達12萬門，內部使用RAM作電路結構，速度高達幾百MHZ，且可任意規(guī)劃更改電路，是一個可隨心所欲的設計芯片。
板載USB-Blaster下載調試器，用戶只需一根USB連接線即可完成程序的加載、固化、調試。
8M-Byte SDRAM
4M-Bits EPCS4
50M系統(tǒng)時鐘
JTAG編程調試接口
7個HR-EXT標準擴展接口
四路時鐘輸入接口
1個復位按鍵
5V/DC電源輸入接口

平臺母板規(guī)格說明：
8位撥動開關輸入模塊
8位按鍵開關輸入模塊
4*4矩陣鍵盤輸入模塊
8位LED顯示模塊
8位動態(tài)掃描的數碼管顯示模塊
16*16點陣顯示模塊
1602字符液晶顯示模塊
12864圖形點陣LCD顯示模塊
高速8位并行AD轉換模塊
2路高速8位并行DA轉換模塊
頻率、幅度均可調的正弦波、三角波、方波模擬量輸出模塊
蜂鳴器、喇叭輸入接口模塊
1個四向模擬交通燈控制模塊
1個四相步進電機控制模塊
1個速度可控、可測直流電機模塊
1個VGA接口
2個UART串行通信接口
2個PS2鼠標、鍵接接口模塊
三、實驗項目：
EDA設計示例                            

基于QUARTUSII圖形輸入電路的設計
基于VHDL格雷碼編碼器的設計
含異步清零和同步使能的加法計數器
八位七段數碼管動態(tài)顯示電路的設計
數控分頻器的設計
圖形和VHDL混合輸入的電路設計
基本觸發(fā)器的設計
可控脈沖發(fā)生器的設計
基于VHDL的搶答器的設計
基于VHDL的表決器的設計
正負脈寬調制信號發(fā)生器設計
矩陣鍵盤接口電路的設計
AUDIO電子音樂實驗
直流電機的測速實驗
步進電機驅動控制
交通燈控制電路實驗
PS2接口鍵盤顯示實驗
VGA彩條信號發(fā)生器的設計
數字頻率計的設計
多功能數字鐘的設計
電梯控制的設計
AD/DA轉換實驗
NIOSII IP CORE設計示例
最小NUISII系統(tǒng)設計
設計一個帶SDRAM和FLASH的NIOSII系統(tǒng)
FLASH讀寫操作-流水燈的設計
……
四、配套軟件
根據不同用戶要求可配套不同版本的軟件，隨機配套的軟件功能齊全，支持Verilog/VHDL硬件描述語言等多種設計輸入。軟件可運行在及Windows XP/WIN7/WIN8/WIN10操作系統(tǒng)下。 
五、產品信息